¡La potencia de AI enfrenta un daño fatal! El director de Broadcom señala las "tres principales limitaciones", y la brecha de capacidad podría persistir hasta 2027

Las restricciones del lado de la oferta de infraestructura básica de cómputo con inteligencia artificial se están extendiendo, pasando de la fabricación de la etapa previa de chips hacia la totalidad de componentes como elementos ópticos y materiales avanzados de empaquetado. Ejecutivos de Broadcom señalan por primera vez las tres grandes limitaciones del ecosistema de suministro de IA, revelando que los verdaderos cuellos de botella de esta carrera armamentista de cómputo de alto rendimiento son mucho más profundos que el entendimiento general del mercado, y que difícilmente podrán resolverse a corto plazo.

El director de marketing de productos en la capa física de Broadcom, Natarajan Ramachandran, señaló en un encuentro con medios celebrado en Taipéi el 24 de marzo que el ecosistema de suministro relacionado con la IA actualmente enfrenta tres cuellos de botella centrales: capacidad de producción de láseres, obleas (específicamente procesos avanzados de TSMC) y PCB (Paddle Card, tarjetas de circuitos impresos). De esas, el plazo de entrega de las pequeñas PCB dentro de los transceptores ópticos de alta velocidad pasó de aproximadamente seis semanas a alrededor de seis meses de forma abrupta; se espera que solo hacia 2027 se pueda aliviar.

El significado directo de estas declaraciones para el mercado es: el auge de inversión en infraestructura de IA no puede resolver de manera automática las restricciones estructurales del lado de la oferta. Desde un rendimiento por debajo del 30% bajo pruebas de láseres extremadamente exigentes, hasta un rendimiento inicial bajo en el empaquetado avanzado de TSMC, y luego pasando por que el periodo de certificación para proveedores de PCB se extiende hasta seis meses o más: al superponerse múltiples cuellos de botella, se traduce en que el déficit de capacidad de cómputo muy probablemente persistirá de forma estructural; además, los aumentos de precios de la cadena de suministro podrían volverse una constante.

Broadcom: director ejecutivo Hock Tan también confirmó en la reunión de resultados de marzo que Broadcom ya ha asegurado de forma anticipada el suministro de componentes clave para 2026 a 2028, abarcando obleas de procesos avanzados, memoria de alto ancho de banda (HBM) y sustratos. Este planeamiento adelantado en sí mismo es una representación directa del nivel actual de tensión en el suministro.

PCB: el ciclo de entrega se dispara diez veces

En los módulos de transceptor óptico de alta gama de 800G/1.6T, la PCB es la interfaz clave que conecta los cables externos con los componentes optoelectrónicos internos. Estas PCB pequeñas, debido a que el espacio es extremadamente reducido y deben manejar señales de muy alta frecuencia, suelen usar el proceso mSAP (método mejorado de semiadición), con umbrales tecnológicos mucho más altos que los de una PCB convencional; normalmente las suministran fabricantes que cuentan con tecnología de alta gama HDI o de sustratos para IC.

La raíz de que la PCB se convierta en un cuello de botella reside en la superposición de procesos. El proceso mSAP y el proceso de sustratos de IC requeridos por los servidores de IA tienen cierta intersección; cuando el mundo acapara la capacidad de producción de HBM, la capacidad de las PCB pequeñas se ve igualmente comprimida. Al mismo tiempo, los requisitos de calidad del 1.6T para la calidad de señal son extremadamente estrictos: la PCB debe emplear materiales con pérdida ultrabaja y control de impedancia preciso, por lo que no la pueden atender fabricantes de PCB comunes.

Lo más importante es que, una vez que se cambia de proveedor, el ciclo de certificación dura más de seis meses. Esta es precisamente la razón por la que gigantes de la nube como Google y Meta prefieren firmar contratos a largo plazo de tres a cuatro años, con el fin de asegurar la capacidad del proveedor existente.

Láseres: rendimiento por debajo de tres décimas, y la capacidad de fosfuro de indio (InP) como punto de bloqueo clave

El componente láser se ha convertido en otro gran cuello de botella en la era de CPO (optica empaquetada en común). Para respaldar 1.6T e incluso mayores anchos de banda, los láseres deben mantener estable su longitud de onda en entornos de alta temperatura en centros de datos, con requisitos estrictos para láseres de onda continua (CW) de “potencia ultraalta” y “ruido extremadamente bajo”. Aunque los proveedores puedan producir chips de láser y, tras someterlos a rigurosas pruebas de confiabilidad, el rendimiento que cumpla los estándares de alta exigencia de CPO podría ser inferior al 30%.

Las limitaciones de capacidad también son severas. Los láseres de alta potencia dependen de la tecnología de fosfuro de indio (InP); y son muy pocos los fabricantes en el mundo que tienen capacidad de producción en masa a gran escala de InP de 6 pulgadas. Si los pedidos a fabricantes de obleas de epitaxia InP del upstream se llenan por completo, o si los fabricantes con capacidad propia como Coherent y Lumentum tienen los pedidos colmados, entonces, no importa cuántos fabricantes de empaquetado haya aguas abajo: no habrá chips de láser disponibles.

La presión estructural más profunda proviene del efecto de amplificación que la propia arquitectura CPO genera sobre la demanda de láseres. En los módulos ópticos tradicionales, un módulo configura un láser; pero en el esquema CPO, para reducir el impacto térmico, la industria se mueve hacia una arquitectura ELSFP (módulo de fuente de láser óptico externo), lo que hace que la cantidad de chips de láser ya no sea una relación lineal con el número de conmutadores (switches), sino que crezca de forma multiplicada, golpeando directamente la capacidad de epitaxia de InP que ya estaba ajustada.

Obleas y empaquetado avanzado: el verdadero “super atasco” ocurre en la etapa posterior (back-end)

En el lado de suministro de obleas, Natarajan Ramachandran expresó directamente que “la capacidad de TSMC ha llegado al límite”, y que se prevé que las líneas de procesos avanzados de TSMC formen un cuello de botella en 2026, aunque TSMC planee seguir ampliando capacidad hasta 2027.

Sin embargo, el verdadero “super atasco” ocurre en la etapa posterior del empaquetado avanzado. Al entrar en la era CPO, TSMC debe introducir la tecnología COUPE (motor fotónico de uso general y compacto), mediante apilamiento tridimensional de chips ópticos y chips de silicio por medio de enlace híbrido (Hybrid Bonding). Esta nueva tecnología de empaquetado tiene una dificultad muy alta y un ciclo de pruebas extremadamente largo, lo que hace que la producción unitaria inicial (UPH) no pueda incrementarse rápidamente.

La dinámica competitiva intensifica aún más la presión sobre la capacidad. En 2026, los rivales de Broadcom en capacidad ya no serán solo los fabricantes tradicionales de comunicaciones de red, sino también NVIDIA, Apple, AMD, Qualcomm, y además Google y Meta, OpenAI, que están desarrollando en gran medida ASIC propios. Cuando los chips de cómputo de IA de nivel más alto y los conmutadores de red 1.6T de nivel más alto ingresan simultáneamente a la misma línea de TSMC, la capacidad en términos prácticos ya entra en un régimen de “racionamiento”.

Incluso si TSMC decide ampliar de forma masiva la capacidad ahora, los plazos para construcción de fábricas, finalización de salas blancas, la incorporación de equipos de litografía ultravioleta extrema (EUV) de ASML y diversos equipos avanzados de prueba suelen oscilar entre doce y dieciocho meses como mínimo. Esto significa que la capacidad de 2026, en realidad, ya había sido asegurada por grandes fabricantes entre 2024 y 2025; los clientes que ahora agregan pedidos solo pueden esperar hasta 2027, cuando se libere la nueva capacidad.

Desbordamiento de la cadena completa: la ampliación de capacidad de proveedores de segunda línea se queda atrás, y el cuello de botella se propaga

La presión de capacidad se desborda hacia toda la cadena de suministro. El empaquetado avanzado no es solo un asunto de las fábricas de empaquetado; los pasos que más fácilmente forman cuellos de botella incluyen: sustratos ABF que deben ir acompañados para CoWoS, el adhesivo de relleno inferior necesario para el empaquetado avanzado (Underfill), los requerimientos de enfriamiento provocados por el estallido de consumo de energía de la IA, pruebas KGD y pruebas de envejecimiento (Burn-in), CPO y módulos ópticos, y también el corte y taladrado de TSV y capas de interposición, entre otros.

El presidente de la junta de TSMC, Wei Zhejia, alguna vez dijo que “la capacidad de CoWoS todavía no alcanza”—y no es que le falte dinero, sino capacidad de proveedores de apoyo: fabricantes de paneles (carrier boards), fabricantes de tarjetas de sonda, proveedores de adhesivo de relleno inferior, etc. TSMC puede invertir grandes sumas en construir fábricas, pero no puede obligar a esos proveedores medianos y pequeños a duplicar su capacidad en el corto plazo. La ampliación de ABF suele requerir de dos a tres años, el tiempo de pruebas de envejecimiento es muy largo; las tolerancias de alineación de arreglos de fibra están a nivel de submicrómetros y no se pueden automatizar completamente: cada etapa va retrasando el ritmo general.

A medida que NVIDIA continúa impulsando iteraciones de hardware sobre su arquitectura GPU, los cuellos de botella de la cadena de suministro y los problemas de aumento de precios podrían convertirse en una constante estructural, en lugar de una perturbación cíclica. Para los inversores, el lugar donde están los cuellos de botella de capacidad es precisamente donde se concentra el poder de fijación de precios.

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