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Google a publié la huitième génération de TPU, la formation et l'inférence étant désormais séparées sur deux puces indépendantes

2026-06-23 00:50:33

Création du résumé en cours

ME News Actualités, le 22 avril (UTC+8), selon le monitoring de Dongcha Beating, le PDG de Google Sundar Pichai a annoncé la huitième génération de TPU lors de Cloud Next 2026, séparant pour la première fois la formation et l'inférence en deux puces indépendantes. TPU 8t destiné à la formation. Un seul nœud super peut connecter 9600 TPU, offrant une puissance de calcul de 121 ExaFlops et 2PB de mémoire à haute bande passante partagée, avec des performances de traitement 3 fois supérieures à la génération précédente Ironwood, et une efficacité énergétique améliorée jusqu'à 2 fois. La bande passante d'interconnexion entre les puces a doublé, en coordination avec la nouvelle topologie réseau Virgo, pouvant former un cluster logique unique avec jusqu'à un million de puces, permettant une extension quasi linéaire. Google affirme que l'objectif est de réduire le cycle de développement des modèles de pointe de plusieurs mois à quelques semaines. TPU 8i destiné à l'inférence. Un seul pod connecte 1152 TPU, équipé de 288 Go de mémoire à haute bande passante et de 384 Mo de SRAM intégré, ce dernier étant 3 fois plus que Ironwood, pour garder autant que possible les données du modèle actif sur la puce. La nouvelle topologie réseau Boardfly réduit considérablement la latence, Google affirme qu'à coût égal, elle peut servir près du double de clients, avec pour objectif de supporter des millions d'agents en fonctionnement simultané. Les deux puces sont hébergées sur le CPU Axion d'architecture Arm développée par Google, avec un refroidissement liquide de quatrième génération. La sortie est prévue pour la fin 2026 sur la plateforme Google Cloud AI Hypercomputer, en parallèle avec les instances GPU d'NVIDIA. (Source : BlockBeats)

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