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𝗠𝗶𝗰𝗿𝗼𝗻 𝗠𝗮𝗿𝗸𝗲𝘁 𝗖𝗮𝗽 𝗕𝗿𝗲𝗮𝗸𝘀 $1 𝗧𝗿𝗶𝗹𝗹𝗶𝗼𝗻 — 𝗟𝗲 𝗦𝗲𝗺𝗶𝗰𝗼𝗻𝗱𝘂𝗰𝘁𝗼𝗿 𝗦𝘂𝗽𝗲𝗿𝗰𝘆𝗰𝗹𝗲 𝗲𝗻𝘁𝗿𝗲 𝗱𝗲𝘀 𝗺𝗲𝗶𝗹𝗹𝗲𝘂𝗿𝗲𝘀 𝗱𝗲 𝗹𝗲 𝗺𝗮𝗿𝗸𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗰𝗵𝗶𝗽𝘀 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗺𝗮𝗿𝗶𝗻𝗲𝗿𝗲 𝗱𝗲 𝗹𝗲𝘀 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲𝘀 𝗲𝗻 𝗮𝗶𝗱𝗲𝗻𝗻𝗲𝗿 𝗱𝗲 𝗹𝗲𝘀 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲𝘀 𝗱𝗲 𝗹'𝗶𝗻𝗳𝗼𝗿𝗺𝗮𝘁𝗶𝗾𝘂𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗰𝗼𝗺𝗽𝘂𝘁𝗮𝘁𝗶𝗼𝗻 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗰𝗼𝗺𝗽𝘂𝘁𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗰𝗼𝗺𝗽𝘂𝘁𝗮𝘁𝗶𝗼𝗻 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺𝗼𝗱𝗲 𝗱𝗲 𝗹𝗲 𝗰𝗵𝗶𝗽 𝗲𝘁 𝗱𝗲 𝗹𝗮 𝗺𝗲𝗺𝗼𝗶𝗿𝗲 𝗲𝗻 𝗶𝗻𝗳𝗿𝗮𝘀𝘁𝗿𝘂𝗰𝘁𝘂𝗿𝗲 𝗱𝗲 𝗹𝗮 𝗺�